EP 0112894 A1 19840711 - POWER BUS ROUTING FOR GATE ARRAYS.
Title (en)
POWER BUS ROUTING FOR GATE ARRAYS.
Title (de)
STROMVERSORGUNGSFÜHRUNG FÜR EINE TORSCHALTUNGSANORDNUNG.
Title (fr)
ACHEMINEMENT D'UN BUS D'ALIMENTATION POUR DES RESEAUX DE PORTES.
Publication
Application
Priority
US 39423982 A 19820701
Abstract (en)
[origin: WO8400252A1] A gate array (10) which has power bus routing for increasing current availability to a plurality of transistor cells (14, 16). The gate array (10) also has separate power busses for input/internal logic and output circuits. The gate array (10) comprises n columns of transistor cells with two power busses (18 and 20) extending substantially along each column to power the cells. Input/internal logic power busses (22 and 24) and separate output power busses (30 and 32) extend around the perimeter of the columns of transistor cells. At least one power strip (36) for increasing current availability to the transistor cells (14, 16) is routed across the transistor cells substantially perpendicular to the n columns and is connected to both the power busses of each column and to the input/internal logic power busses.
Abstract (fr)
Un réseau de portes (10) possède un bus d'alimentation pour augmenter le courant disponible dans plusieurs cellules de transistors (14, 16). Le réseau de portes (10) possède également des bus d'alimentation séparés pour des circuits de sortie et d'entrée/logique interne. Le réseau de portes (10) comprend n colonnes de cellules de transistors avec deux bus d'alimentation (18 et 20) s'étendant sensiblement le long de chaque colonne pour alimenter les cellules. Des bus d'alimentation d'entrée/logique interne (22 et 24) et des bus d'alimentation de sortie séparés (30 et 32) s'étendent autour du périmètre des colonnes des cellules de transistors. Au moins une bande d'alimentation (36) pour augmenter la disponibilité de courant dans les cellules de transistors (14, 16) est acheminée au travers des cellules de transistors sensiblement perpendiculairement aux n colonnes et est connectée aux deux bus d'alimentation de chaque colonne et aux bus d'alimentation d'entrée/logique interne.
IPC 1-7
H01L 23/48; H01L 29/44; H01L 29/52; H01L 29/60; H01L 27/10; H01L 27/15
IPC 8 full level
H01L 21/822 (2006.01); H01L 21/82 (2006.01); H01L 23/48 (2006.01); H01L 23/52 (2006.01); H01L 25/07 (2006.01); H01L 25/11 (2006.01); H01L 27/04 (2006.01); H01L 27/10 (2006.01); H01L 27/118 (2006.01); H01L 27/15 (2006.01)
CPC (source: EP US)
H01L 23/52 (2013.01 - EP US); H01L 25/071 (2013.01 - EP US); H01L 25/112 (2013.01 - EP US); H01L 2924/0002 (2013.01 - EP US)
Designated contracting state (EPC)
DE FR GB NL SE
DOCDB simple family (publication)
WO 8400252 A1 19840119; DE 3370563 D1 19870430; EP 0112894 A1 19840711; EP 0112894 A4 19840914; EP 0112894 B1 19870325; JP H0695553 B2 19941124; JP S59501238 A 19840712; SG 67289 G 19900126; US 4511914 A 19850416
DOCDB simple family (application)
US 8300890 W 19830606; DE 3370563 T 19830606; EP 83902340 A 19830606; JP 50244783 A 19830606; SG 67289 A 19890930; US 39423982 A 19820701