EP 0227156 A2 19870701 - Delay line tuning control circuit.
Title (en)
Delay line tuning control circuit.
Title (de)
Regelschaltung zum Abgleich einer Laufzeitleitung.
Title (fr)
Circuit de réglage pour l'accord d'une ligne à retard.
Publication
Application
Priority
DE 3544342 A 19851214
Abstract (en)
[origin: US4805021A] Control circuit for calibrating a delay line for a television receiver. The delay line contains series-connected all-pass sections of at least 2nd-order, the inductances of which are replaced by gyrators to which capacitances are connected. During at least one line of the vertical blanking period, the delay line is included into a phase-lock loop for comparison with a line-frequency signal in order to control the delay time of the all-pass sections.
Abstract (de)
Die Erfindung betrifft eine Regelschaltung zum Abgleich einer Laufzeitleitung (20) für einen Fernsehempfänger. Die Laufzeitleitung (20) enthält in Reihe geschaltete Allpaßglieder von mindestens 2. Ordnung, deren Induktivitäten durch mit Kapazitäten beschaltete Gyratoren ersetzt sind. Während wengstens einer Zeile der Vertikalaustastzeit wird die Laufzeitleitung (20) in einen Phasenregelkreis (27, 28, 30) zum Vergleich mit einem zeilenfrequenten Signal einbezogen, um so die Verzögerungszeit der Allpaßglieder zu regeln.
IPC 1-7
IPC 8 full level
H04N 5/953 (2006.01); H03H 11/26 (2006.01); H04N 5/14 (2006.01); H04N 9/64 (2006.01); H04N 9/77 (2006.01)
CPC (source: EP US)
H03H 11/26 (2013.01 - EP US)
Designated contracting state (EPC)
DE FR GB IT
DOCDB simple family (publication)
DE 3544342 C1 19870507; DE 3685643 D1 19920716; EP 0227156 A2 19870701; EP 0227156 A3 19890308; EP 0227156 B1 19920610; JP H06105963 B2 19941221; JP S62141874 A 19870625; US 4805021 A 19890214
DOCDB simple family (application)
DE 3544342 A 19851214; DE 3685643 T 19861202; EP 86202142 A 19861202; JP 29504986 A 19861212; US 93938586 A 19861208