EP 0290467 A1 19881117 - APPARATUS AND METHOD FOR A MICROPROGRAMMED DATA PROCESSING SYSTEM HAVING A PLURALITY OF CONTROL STORES.
Title (en)
APPARATUS AND METHOD FOR A MICROPROGRAMMED DATA PROCESSING SYSTEM HAVING A PLURALITY OF CONTROL STORES.
Title (de)
GERÄT UND VERFAHREN FÜR EIN MIKROPROGRAMMIERTES DATENVERARBEITUNGSSYSTEM MIT EINER MEHRZAHL VON BEFEHLSSPEICHERN.
Title (fr)
APPAREIL ET PROCEDE POUR SYSTEME MICROPROGRAMME DE TRAITEMENT DE DONNEES A PLUSIEURS MEMOIRES MICROPROGRAMMABLES.
Publication
Application
Priority
US 82380486 A 19860129
Abstract (en)
[origin: WO8704819A1] A microprogrammed data processing system in which a plurality of control stores are used to control the data processing system in reponse to a macroinstruction sequence. Between each control store is a latch element resulting in a given address being applied to each control store at different system clock cycles. The corresponding microinstruction segment from each control store is therefore provided at different clock cycles, making it possible to coordinate the microinstruction segment with the corresponding flow of data through the central processing unit. The use of a plurality of control stores can reduce the number of gate elements needed to delay microinstruction segments.
Abstract (fr)
Un système microprogrammé de traitement de données comprend plusieurs mémoires microprogrammables destinées à commander le système de traitement de données en fonction d'une séquence de macro-instructions. La présence d'un élément de bascule entre chaque mémoire microprogrammable se traduit par l'application d'une adresse donnée à chaque mémoire microprogrammable pendant des cycles d'horloge de systèmes différents. Le segment de micro-instructions correspondant donc lu dans la mémoire microprogrammable pendant des cycles d'horloge différents, ce qui permet de coordonner le segment de micro-instructions avec le flux de données correspondantes qui traverse l'unité centrale de taitement. L'utilisation de plusieurs mémoires microprogrammables permet de réduire le nombre d'éléments de portes nécessaires pour retarder les segments de micro-instructions.
IPC 1-7
IPC 8 full level
G06F 9/22 (2006.01); G06F 9/28 (2006.01); G06F 9/38 (2006.01)
CPC (source: EP KR US)
G06F 9/22 (2013.01 - KR); G06F 9/223 (2013.01 - EP US); G06F 9/28 (2013.01 - EP US)
Citation (search report)
See references of WO 8704819A1
Designated contracting state (EPC)
CH DE FR GB IT LI NL
DOCDB simple family (publication)
WO 8704819 A1 19870813; AU 6932187 A 19870825; CA 1278385 C 19901227; CN 1008667 B 19900704; CN 87102161 A 19870909; EP 0290467 A1 19881117; ES 2004200 A6 19881216; IL 81428 A0 19870831; IL 81428 A 19901105; JP H01500065 A 19890112; KR 880700966 A 19880413; KR 910001054 B1 19910223; US 4794527 A 19881227
DOCDB simple family (application)
US 8700180 W 19870129; AU 6932187 A 19870129; CA 528358 A 19870128; CN 87102161 A 19870129; EP 87901238 A 19870129; ES 8700206 A 19870128; IL 8142887 A 19870129; JP 50106187 A 19870129; KR 870700871 A 19870925; US 82380486 A 19860129