EP 0478745 A1 19920408 - HIGH PERFORMANCE INTERLOCK COLLAPSING SCISM ALU APPARATUS.
Title (en)
HIGH PERFORMANCE INTERLOCK COLLAPSING SCISM ALU APPARATUS.
Title (de)
HOCHLEISTUNGS-SCISM-ALU-GERÄT ZUR VERRIEGELUNGSVERHINDERUNG.
Title (fr)
UNITE ARITHMETIQUE ET LOGIQUE SCISM TRES PERFORMANTE A REDUCTION DE VERROUILLAGE (INTERLOCK COLLAPSING).
Publication
Application
Priority
- US 50491090 A 19900404
- US 61986890 A 19901128
Abstract (en)
[origin: WO9115820A1] A status determination apparatus, includes a three-to-one arithmetic logic unit (ALU), for predicting the status of the ALU operations related to the carries incorporated in the ALU which is designed to execute a second instruction of an interlock instruction pair in parallel whether or not the second instruction is independent or dependent on a result of the operation of the first instruction. An apparatus is developed (Figs. 2-3) for generating carries (C0, C1) due to the second instruction of the interlock instruction pair when executing all combinations of logical and aritthmetic pair. A critical path for calculating the carries ( lambda ) is first presented. Next, the expression for generating the carries ( lambda ) is used to derive a fast implementation (Figs. 4-5) for generating an overflow (OF). Additionally, an implementation scheme is developed for predicting result equal to zero (Fig. 6).
Abstract (fr)
On présente trois variantes très performantes d'une unité arithmétique et logique à réduction de verrouillage (interlock collapsing). Le temps d'exécution suivant le chemin critique dans chaque variante est réduit. Dans l'une de ces variantes, ledit temps d'exécution correspond au nombre d'étapes qu'effectue un additionneur trois-à-un dans le cas d'un ensemble fonctionnel (bookset) courant. Dans les deux autres variantes, le temps d'exécution est comparable à celui de l'additionneur trois-à-un. On présente également les compromis adoptés en matière de complexité dans la conception desdites variantes. L'utilisation de ces dernières permet de réduire au minimum les temps d'exécution sans augmenter de manière inacceptable le nombre de composants du matériel.
IPC 1-7
IPC 8 full level
G06F 7/00 (2006.01); G01N 33/04 (2006.01); G01N 33/44 (2006.01); G06F 7/50 (2006.01); G06F 7/508 (2006.01); G06F 7/575 (2006.01); G06F 9/302 (2006.01); G06F 9/38 (2006.01)
CPC (source: EP US)
G06F 7/575 (2013.01 - EP US); G06F 9/3001 (2013.01 - EP US); G06F 9/3836 (2013.01 - EP US); G06F 9/3853 (2013.01 - EP US); G06F 7/4991 (2013.01 - EP US)
Designated contracting state (EPC)
DE FR GB
DOCDB simple family (publication)
WO 9115820 A1 19911017; EP 0478731 A1 19920408; EP 0478731 A4 19930922; EP 0478745 A1 19920408; EP 0478745 A4 19930901; JP H04505821 A 19921008; JP H04505822 A 19921008; JP H07122846 B2 19951225; JP H0827708 B2 19960321; US 5299319 A 19940329; WO 9115819 A1 19911017
DOCDB simple family (application)
US 9102039 W 19910329; EP 91907190 A 19910329; EP 91907742 A 19910329; JP 50736891 A 19910329; JP 50736991 A 19910329; US 67707991 A 19910329; US 9102038 W 19910329