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<ep-patent-document id="EP97107599B1" file="EP97107599NWB1.xml" lang="de" country="EP" doc-number="0809169" kind="B1" date-publ="20000809" status="n" dtd-version="ep-patent-document-v1-1">
<SDOBI lang="de"><B000><eptags><B001EP>......DE....FRGB..IT..............................</B001EP><B005EP>J</B005EP><B007EP>DIM360   - Ver 2.9 (30 Jun 1998)
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<p id="p0001" num="0001">Die Erfindung betrifft eine ein-/ausschaltbare Schaltungsanordnung zur Erzeugung eines Referenzpotentials mit einem ersten Transistor, dessen Emitter mit einem Bezugspotential verbunden ist und dessen Basis und Kollektor miteinander verschaltet sind, mit einem zweiten Transistor, dessen Basis mit der Basis des ersten Transistors verbunden ist, mit einem ersten Widerstand, der zwischen den Kollektor des ersten Transistors und einem Ausgangsanschluß zum Abgreifen des Referenzpotentials geschaltet ist, mit einem zweiten Widerstand, der zwischen den Kollektor des zweiten Transistors und des Ausgangsanschluß geschaltet ist, mit einem dritten Widerstand, der zwischen den Emitter des zweiten Transistors und das Bezugspotential geschaltet ist, mit einem dritten Transistor, dessen Basis mit dem Kollektor des zweiten Transistors und dessen Emitter mit dem Bezugspotential verbunden ist, und mit einer gesteuerten Stromquelle, die zwischen ein Versorgungspotential und den Ausgangsanschluß geschaltet ist und die eingangsseitig mit dem Kollektor des dritten Transistors gekoppelt ist.</p>
<p id="p0002" num="0002">Eine derartige, auch schaltbare Bandgap-Referenz bezeichnete Schaltungsanordnung ist beispielsweise aus Paul R. Gray, Robert G. Meyer, Analysis and Design of Analog Integrated Circuits, Second Edition, John Wiley and Sons, 1984, Seiten 293 bis 296, bekannt.</p>
<p id="p0003" num="0003">In Zukunft wird es bei integrierten Schaltkreisen zunehmend wichtiger, daß zum Zwecke der Stromersparnis sich zumindest Teile der Schaltkreise Ein- und Ausschalten lassen. Demzufolge werden mehr und mehr auch ein- bzw. abschaltbare Referenzspannungsquellen verwendet, da die Referenzspannungsquelle im abgeschalteten Zustand möglichst keinen Strom verbrauchen<!-- EPO <DP n="2"> --> sollte, bietet es sich an, die Referenzspannungsquelle durch eine in Serie geschaltete Schalteinrichtung ein-/abzuschalten. Üblicherweise liegt dabei ein pnp-Transistor in Reihe zu einer Bandgap-Referenz als Referenzspannungsquelle, so daß die Versorgungsspannung höher sein muß, als eigentlich für die Bandgap-Referenz selbst notwendig ist. Außerdem lassen sich pnp-Transistoren in Standard-Technologie nur als großflächige Lateraltransistoren realisieren. Dabei ist häufig der Basisstrom zur Ansteuerung des pnp-Transistors nicht vernachlässigbar und erhöht die Stromaufnahme beim Betrieb.</p>
<p id="p0004" num="0004">Aufgabe der Erfindung ist es, eine ein-/ausschaltbare Schaltungsanordnung zur Erzeugung eines Referenzpotentials anzugeben, die diese Nachteile nicht aufweist.</p>
<p id="p0005" num="0005">Die Aufgabe wird durch eine Schaltungsanordnung gemäß Patentanspruch 1 gelöst. Ausgestaltungen und Weiterbildungen des Erfindungsgedankens sind Gegenstand von Unteransprüchen.</p>
<p id="p0006" num="0006">Zur Vermeidung eines großen Flächenbedarfs und unnötiger Spannungs- und Stromverluste werden die Schaltmittel in die Bandgap-Referenz miteinbezogen. Insbesondere wird bei einer Schaltungsanordnung der eingangs genannten Art der Kollektor-Emitter-Strecke des dritten Transistors die Kollektor-Emitter-Strecke eines fünften Transistors parallel geschaltet und die Basis des fünften Transistors durch ein Schaltsignal angesteuert.</p>
<p id="p0007" num="0007">Bei einer Ausgestaltung der Erfindung weist die gesteuerte Stromquelle einen vierten Transistor auf, dessen Kollektor mit dem Versorgungspotential, dessen Emitter mit dem Ausgangsanschluß und dessen Basis mit dem Kollektor des dritten Transistors verbunden ist. Zwischen Basis und Kollektor des vierten Transistors ist dabei eine weitere Stromquelle geschaltet. Weiterhin kann die weitere Stromquelle einen sechsten Transistor aufweisen, dessen Basis mit dem Ausgangsanschluß<!-- EPO <DP n="3"> --> und dessen Emitter unter Zwischenschaltung eines vierten Widerstandes mit dem Bezugspotential verbunden ist. Des weiteren sind ein siebter Transistor, dessen Emitter unter Zwischenschaltung eines fünften Widerstandes mit dem Versorgungspotential verbunden ist, dessen Kollektor mit der Basis des vierten Transistors verschaltet ist und dessen Basis mit dem Kollektor des sechsten Transistors gekoppelt ist, sowie ein achter Transistor, dessen Basis und Kollektor miteinander sowie mit dem Kollektor des sechsten Transistors gekoppelt sind und dessen Emitter unter Zwischenschaltung eines sechsten Widerstandes mit dem Versorgungspotential verbunden ist, vorgesehen.</p>
<p id="p0008" num="0008">Um die Anlaufeigenschaften beim Einschalten zu verbessern, wird vorgesehen, daß der Kollektor-Emitter-Strecke des sechsten Transistors die Kollektor-Emitter-Strecke eines neunten Transistors parallel geschaltet ist und daß dabei die Basis des neunten Transistors durch das Schaltsignal angesteuert wird.</p>
<p id="p0009" num="0009">Darüber hinaus kann zwischen die Basen von sechstem und neuntem Transistor ein siebter Widerstand geschaltet werden. Ferner kann das Schaltsignal über einen achten Widerstand der Basis des neunten Transistors zugeführt werden.</p>
<p id="p0010" num="0010">Eine Weiterbildung der Erfindung enthält einen zehnten Transistor, dessen Emitter mit den Basen von siebtem und achtem Transistor und dessen Kollektor mit dem Bezugspotential verbunden ist. Weiterhin ist ein elfter Transistor vorgesehen, dessen Kollektor mit dem Versorgungspotential, dessen Basis mit dem Kollektor des achten Transistors und dessen Emitter mit der Basis des zehnten Transistors verbunden ist. Die Basis des neunten Transistors ist dabei mit dem Eingangszweig eines Stromspiegels gekoppelt, dessen Ausgangszweig mit der Basis des zehnten Transistors gekoppelt ist.<!-- EPO <DP n="4"> --></p>
<p id="p0011" num="0011">Zwischen die Basen von siebtem und achtem Transistor einerseits und das Versorgungspotential andererseits kann ein elfter Transistor geschaltet werden, der zur Erhöhung der Stabilität beiträgt.</p>
<p id="p0012" num="0012">Schließlich kann vorgesehen werden, daß das Schaltsignal den Basen von fünftem und sechstem Transistor jeweils unter Zwischenschaltung einer Pufferstufe zugeführt wird.</p>
<p id="p0013" num="0013">Die Erfindung wird nachfolgend anhand des in der einzigen Figur der Zeichnung dargestellten Ausführungsbeispiels näher erläutert.</p>
<p id="p0014" num="0014">Bei der als Ausführungsbeispiel gezeigten erfindungsgemäßen Schaltungsanordnung ist ein npn-Transistor T1 vorgesehen, dessen Emitter mit dem Bezugspotential M verbunden ist und dessen Basis und Kollektor miteinander verschaltet und über einen gemeinsamen Widerstand R1 mit einem ein Referenzpotential führenden Ausgangsanschluß U gekoppelt sind. An Basis und Kollektor des Transistors T1 ist die Basis eines npn-Transistors T2 angeschlossen, dessen Emitter über einen Widerstand R3 mit dem Bezugspotential M und dessen Kollektor über einen Widerstand R2 mit dem Ausgangsanschluß U gekoppelt ist.</p>
<p id="p0015" num="0015">An dem Ausgangsanschluß U ist darüber hinaus der Emitter eines npn-Transistors T4 angeschlossen, dessen Kollektor mit einem Versorgungspotential V verbunden ist. Die Basis des Transistors T4 ist mit dem Kollektor eines npn-Transistors T3 verbunden, dessen Emitter an das Bezugspotential M und dessen Basis an den Kollektor des Transistors T2 angeschlossen ist.</p>
<p id="p0016" num="0016">Die Basis des Transistors T4 ist darüber hinaus über eine Stromquellenschaltung an das Versorgungspotential V angeschlossen. Die Stromquellenschaltung weist einen pnp-Transistor T7 auf, dessen Emitter über einen Widerstand R5 mit dem Versorgungspotential V und dessen Kollektor mit der Basis<!-- EPO <DP n="5"> --> des Transistors T4 bzw. dem Kollektor des Transistors T3 verbunden ist. Die Basis des Transistors T7 ist mit der Basis eines pnp-Transistors T8 verschaltet, dessen Emitter über einen Widerstand R6 mit dem Versorgungspotential V gekoppelt ist. Der Kollektor des Transistors T8 ist darüber hinaus mit dem Kollektor eines npn-Transistors T6 verbunden, dessen Emitter über einen Widerstand R4 an das Bezugspotential M angeschlossen ist und dessen Basis mit dem Ausgangsanschluß U verbunden ist.</p>
<p id="p0017" num="0017">Neben dem Ausgangsanschluß U, an dem das Referenzpotential abgreifbar ist, kann darüber hinaus ein Ausgangsanschluß I vorgesehen werden, der einen Referenzstrom führt. Dazu ist der Ausgangsanschluß I mit dem Kollektor eines pnp-Transistors T16 verbunden, dessen Emitter über einen Widerstand R14 mit dem Versorgungspotential V verbunden ist und dessen Basis mit den Basen der Transistoren T7 und T8 verschaltet ist.</p>
<p id="p0018" num="0018">Erfindungsgemäß ist der Kollektor-Emitter-Strecke des Transistors T3 die Kollektor-Emitter-Strecke eines pnp-Transistors T5 parallelgeschaltet. Somit ist der Emitter des Transistors T5 mit der Basis des Transistors T4 verbunden und der Kollektor des Transistors T5 an das Bezugspotential M angeschlossen. Seine Basis wird unter Zwischenschaltung einer Pufferstufe durch ein Schaltsignal S angesteuert. Die Pufferstufe besteht aus einem pnp-Transistor T14, an dessen Basis das Schaltsignal S angelegt ist, dessen Emitter mit dem Versorgungspotential V gekoppelt ist und dessen Kollektor mit der Basis des Transistors T5 sowie unter Zwischenschaltung eines Widerstandes R12 mit dem Bezugspotential M gekoppelt ist. Anstelle eines pnp-Transistors T5 könnte in gleicher Weise auch ein npn-Transistor bei entsprechender Polung sowie entsprechener Auslegung des Schaltsignals S verwendet werden.</p>
<p id="p0019" num="0019">Weiterhin ist der Kollektor-Emitter-Strecke des Transistors T6 die Kollektor-Emitter-Strecke eines npn-Transistors T9<!-- EPO <DP n="6"> --> parallel geschaltet. Die Basis des Transistors T9 wird unter Zwischenschaltung eines Widerstandes R8 sowie einer weiteren Pufferstufe durch das Schaltsignal S angesteuert. Demgemäß sind die Emitter und die Kollektoren der Transistoren T6 und T9 jeweils miteinander verschaltet. Die weitere Pufferstufe enthält einen pnp-Transistor T15, dessen Emitter mit dem Versorgungspotential V und dessen Basis mit der Basis des Transistors T14 verbunden ist. Der Kollektor des Transistors T15 ist zum einen mit einem Anschluß des Widerstandes R8 und zum anderen über einen Widerstand R13 mit dem Bezugspotential M gekoppelt.</p>
<p id="p0020" num="0020">Die Basis des Transistors T9 ist zudem mit dem Eingangszweig eines Stromspiegels verbunden. Der Eingangszweig wird durch einen npn-Transistor T13 gebildet, dessen Basis und Kollektor miteinander sowie mit der Basis des Transistors T9 verschaltet sind und dessen Emitter unter Zwischenschaltung eines Widerstandes R10 an das Bezugspotential M angeschlossen ist. Der Ausgangszweig des Stromspiegels wird durch einen npn-Transistor T12 gebildet, dessen Basis mit der Basis des Transistors T13 verbunden ist und dessen Emitter unter Zwischenschaltung eines Widerstandes R9 an das Bezugspotential M angeschlossen ist. Der Kollektor des Transistors T12 ist auf die Basis eines pnp-Transistors T10, dessen Kollektor mit dem Bezugspotential M und dessen Emitter mit den Basen der Transistoren T7 und T8 verbunden ist, sowie auf den Emitter eines npn-Transistors T11, dessen Kollektor mit dem Versorgungspotential V und dessen Basis mit dem Kollektor des Transistors T8 verschaltet ist, geführt. Schließlich ist ein Widerstand R11 zwischen die Basen der Transistoren T7 und T8 einerseits und das Versorgungspotential V andererseits geschaltet.</p>
<p id="p0021" num="0021">Werden die Transistoren T14 und T15 durch das Schaltsignal S gesperrt, so sind ihre Kollektorpotentiale annähernd gleich dem Bezugspotential M. Der Transistor T5 ist dann ebenfalls gesperrt und hat auf die Funktion der übrigen Schaltungsteile keinen Einfluß. Der Transistor T4 wird in diesem Fall seiner<!-- EPO <DP n="7"> --> Funktion entsprechend angesteuert. Der Transistor T15 liefert einen Anlaufstrom für die Bandgap-Zelle, die beim vorliegenden Ausführungsbeispiel aus den Transistoren T1 und T2 sowie den Widerständen R1 bis R3 besteht. Werden dagegen die Transistoren T14 und T15 durch das Schaltsignal S durchgesteuert, so ist ihr jeweiliges Kollektorpotential in etwa gleich dem Versorgungspotential V. Der Transistor T5 ist dabei ebenfalls durchgesteuert und erzeugt an der Basis des Transistors T4 ein Potential, das diesen ebenfalls in den sperrenden Zustand bringt. Die Stromaufnahme der Bandgap-Zelle geht damit gegen Null. Der Widerstand R8 sowie dessen Kombination mit einem aus den Transistoren T10 und T11 bestehenden komplementären Emitterfolger unterstützen den Abschaltvorgang.</p>
<p id="p0022" num="0022">Damit liegt in Reihe zur Bandgap-Zelle nur der ohnehin notwendige Transistor T4. Ein weiterer Ein/Ausschalttran-sistor ist nicht notwendig. Somit wird ein serieller Spannungsabfall vermieden und darüber hinaus der zusätzliche Flächenbedarf gering gehalten. Mittels der Transistoren T9 bis T13 in Verbindung mit den Widerständen R8 und R11 werden auch die übrigen Schaltungsteile weitgehend stromlos gehalten, so daß insgesamt der Stromverbrauch im Ruhezustand sowie der gegenüber dem Versorgungsstrom im Betriebsfall notwendige Strom für die Abschalteinrichtungen äußerst gering ist.</p>
</description><!-- EPO <DP n="8"> -->
<claims id="claims01" lang="de">
<claim id="c-de-01-0001" num="0001">
<claim-text>Ein-/Ausschaltbare Schaltungsanordnung zur Erzeugung eines Referenzpotentials mit einem ersten Transistor (T1), dessen Emitter mit einem Bezugspotential (M) verbunden ist und dessen Basis und Kollektor miteinander verschaltet sind,
<claim-text>mit einem zweiten Transistor (T2), dessen Basis mit der Basis des ersten Transistors (T1) verbunden ist,</claim-text>
<claim-text>mit einem ersten Widerstand (R1), der zwischen den Kollektor des ersten Transistors (T1) und einen Ausgangsanschluß (U) zum Abgreifen des Referenzpotentials geschaltet ist,</claim-text>
<claim-text>mit einem zweiten Widerstand (R2), der zwischen den Kollektor des zweiten Transistors (T2) und den Ausgangsanschluß (U) geschaltet ist,</claim-text>
<claim-text>mit einem dritten Widerstand (R3), der zwischen Emitter des zweiten Transistors (T2) und das Bezugspotential (M) geschaltet ist,</claim-text>
<claim-text>mit einem dritten Transistor (T3), dessen Basis mit dem Kollektor des zweiten Transistors (T2) und dessen Emitter mit dem Bezugspotential (M) verbunden ist, und</claim-text>
<claim-text>mit einer gesteuerten Stromquelle (T4), die zwischen ein Versorgungspotential (V) und den Ausgangsanschluß (U) geschaltet ist und die eingangsseitig mit dem Kollektor des dritten Transistors (T3) gekoppelt ist,</claim-text> <b>dadurch gekennzeichnet</b>, daß der Kollektor-Emitter-Strecke des dritten Transistors (T3) die Kollektor-Emitter-Strecke eines fünften Transistors (T5) parallel geschaltet ist und daß die Basis des fünften Transistors (T5) durch ein Schaltsignal (S) angesteuert wird.</claim-text></claim>
<claim id="c-de-01-0002" num="0002">
<claim-text>Schaltungsanordnung nach Anspruch 1,<br/>
<b>dadurch gekennzeichnet</b>, daß die gesteuerte Stromquelle (T4) einen vierten Transistor (T4) aufweist, dessen Kollektor mit dem Versorgungspotential (V), dessen Emitter mit dem Ausgangsanschluß (U) und dessen Basis mit dem Kollektor des dritten Transistors (T3) verbunden ist, und daß zwischen Basis und Kollektor des vierten Transistors<!-- EPO <DP n="9"> --> (T4) eine weitere Stromquelle (T7, T8, R4, R5, R6) geschaltet ist.</claim-text></claim>
<claim id="c-de-01-0003" num="0003">
<claim-text>Schaltungsanordnung nach Anspruch 2,<br/>
<b>dadurch gekennzeichnet</b>, daß die weitere Stromquelle (T6, T7, T8, R4, R5, R6) aufweist:
<claim-text>einen sechsten Transistor (T6), dessen Basis mit dem Ausgangsanschluß (U) und dessen Emitter unter Zwischenschaltung eines vierten Widerstandes mit dem Bezugspotential (M) verbunden ist;</claim-text>
<claim-text>einen siebten Transistor (T7), dessen Emitter unter Zwischenschaltung eines fünften Widerstandes (R5) mit dem Versorgungspotential (V) verbunden ist, dessen Kollektor mit der Basis des fünften Transistors (T5) verschaltet ist und dessen Basis mit dem Kollektor des sechsten Transistors (T6) gekoppelt ist;</claim-text>
<claim-text>einen achten Transistor (T8), dessen Basis und Kollektor miteinander sowie mit dem Kollektor des sechsten Transistors (T6) gekoppelt sind und dessen Emitter unter Zwischenschaltung eines sechsten Widerstandes (R6) mit dem Versorgungspotential (V) verbunden ist.</claim-text></claim-text></claim>
<claim id="c-de-01-0004" num="0004">
<claim-text>Schaltungsanordnung nach Anspruch 2 oder 3,<br/>
<b>dadurch gekennzeichnet</b>, daß der Kollektor-Emitter-Strecke des sechsten Transistors (T6) die Kollektor-Emitter-Strecke eines neunten Transistors (T9) parallel geschaltet ist und daß die Basis des neunten Transistors (T9) durch das Schaltsignal (S) angesteuert wird.</claim-text></claim>
<claim id="c-de-01-0005" num="0005">
<claim-text>Schaltungsanordnung nach Anspruch 4,<br/>
<b>dadurch gekennzeichnet</b>, daß zwischen die Basis von sechstem und neuntem Transistor (T6, T9) ein siebter Widerstand (R7) geschaltet ist.</claim-text></claim>
<claim id="c-de-01-0006" num="0006">
<claim-text>Schaltungsanordnung nach Anspruch 4 oder 5,<br/>
<!-- EPO <DP n="10"> --><b>dadurch gekennzeichnet</b>, daß das Schaltsignal (S) über einen achten Widerstand (R8) der Basis des neunten Transistors (T9) zugeführt wird.</claim-text></claim>
<claim id="c-de-01-0007" num="0007">
<claim-text>Schaltungsanordnung nach einem der Ansprüche 4 bis 6,<br/>
<b>gekennzeichnet durch</b> einen zehnten Transistor (T10), dessen Emitter mit den Basen von siebtem und achtem Transistor (T7, T8) und dessen Kollektor mit dem Bezugspotential verbunden ist, durch einen elften Transistor (T11), dessen Kollektor mit dem Versorgungspotential (V), dessen Basis mit dem Kollektor des achten Transistors (T8) und dessen Emitter mit der Basis des zehnten Transistors (T10) verbunden ist, und durch einen Stromspiegel (T12, T13, R9, R10), dessen Eingangszweig mit der Basis des neunten Transistors (T9) und dessen Ausgangszweig mit der Basis des zehnten Transistors (T10) gekoppelt ist.</claim-text></claim>
<claim id="c-de-01-0008" num="0008">
<claim-text>Schaltungsanordnung nach einem der Ansprüche 3 bis 7,<br/>
<b>dadurch gekennzeichnet</b>, daß zwischen die Basen von siebtem und achtem Transistor (T7, T8) einerseits und das Versorgungspotential (V) andererseits ein elfter Widerstand (R11) geschaltet ist.</claim-text></claim>
<claim id="c-de-01-0009" num="0009">
<claim-text>Schaltungsanordnung nach einem der Ansprüche 4 bis 8,<br/>
<b>dadurch gekennzeichnet</b>, daß das Schaltsignal (S) den Basen von fünftem und neuntem Transistor (T5, T9) jeweils unter Zwischenschaltung einer Pufferstufe (T14, R12; T15, R13) zugeführt wird.</claim-text></claim>
</claims><!-- EPO <DP n="11"> -->
<claims id="claims02" lang="en">
<claim id="c-en-01-0001" num="0001">
<claim-text>Circuit arrangement, capable of being switched on/off, for generating a reference potential, having a first transistor (T1), whose emitter is connected to a reference-earth potential (M) and whose base and collector are connected to one another,
<claim-text>having a second transistor (T2), whose base is connected to the base of the first transistor (T1),</claim-text>
<claim-text>having a first resistor (R1), which is connected between the collector of the first transistor (T1) and a output terminal (U) for picking off the reference potential,</claim-text>
<claim-text>having a second resistor (R2) which is connected between the collector of the second transistor (T2) and the output terminal (U),</claim-text>
<claim-text>having a third resistor (R3), which is connected between the emitter of the second transistor (T2) and the reference-earth potential (M),</claim-text>
<claim-text>having a third transistor (T3) whose base is connected to the collector of the second transistor (T2) and whose emitter is connected to the reference-earth potential (M), and</claim-text>
<claim-text>having a controlled current source (T4) which is connected between a supply potential (V) and the output terminal (U) and is coupled to the collector of the third transistor (T3) on the input side,</claim-text> characterized in that the collector/emitter path of a fifth transistor (T5) is connected in parallel with the<!-- EPO <DP n="12"> --> collector/emitter path of the third transistor (T3), and in that the base of the fifth transistor (T5) is driven by a switching signal (S).</claim-text></claim>
<claim id="c-en-01-0002" num="0002">
<claim-text>Circuit arrangement according to Claim 1,<br/>
characterized in that the controlled current source (T4) has a fourth transistor (T4) whose collector is connected to the supply potential (V), whose emitter is connected to the output terminal (U) and whose base is connected to the collector of the third transistor (T3), and in that a further current source (T7, T8, R4, R5, R6) is connected between the base and collector of the fourth transistor (T4).</claim-text></claim>
<claim id="c-en-01-0003" num="0003">
<claim-text>Circuit arrangement according to Claim 2,<br/>
characterized in that the further current source (T6, T7, T8, R4, R5, R6) has:
<claim-text>a sixth transistor (T6), whose base is connected to the output terminal (U) and whose emitter is connected to the reference-earth potential (M) with the interposition of a fourth resistor;</claim-text>
<claim-text>a seventh transistor (T7), whose emitter is connected to the supply potential (V) with the interposition of a fifth resistor (R5), whose collector is connected up to the base of the fifth transistor (T5) and whose base is coupled to the collector of the sixth transistor (T6);</claim-text>
<claim-text>an eighth transistor (T8), whose base and collector are coupled to one another and also to the collector of the sixth transistor (T6) and whose emitter is connected to the supply potential (V) with the interposition of a sixth resistor (R6).</claim-text></claim-text></claim>
<claim id="c-en-01-0004" num="0004">
<claim-text>Circuit arrangement according to Claim 2 or 3,<br/>
characterized in that the collector/emitter path of a ninth transistor (T9) is connected in parallel with the collector/emitter path of the sixth transistor (T6), and in that the base of the ninth transistor (T9) is driven by the switching signal (S).</claim-text></claim>
<claim id="c-en-01-0005" num="0005">
<claim-text>Circuit arrangement according to Claim 4,<br/>
<!-- EPO <DP n="13"> -->characterized in that a seventh resistor (R7) is connected between the base of the sixth and ninth transistors (T6, T9).</claim-text></claim>
<claim id="c-en-01-0006" num="0006">
<claim-text>Circuit arrangement according to Claim 4 or 5,<br/>
characterized in that the switching signal (S) is fed via an eighth resistor (R8) to the base of the ninth transistor (T9) .</claim-text></claim>
<claim id="c-en-01-0007" num="0007">
<claim-text>Circuit arrangement according to one of Claims 4 to 6,<br/>
characterized by a tenth transistor (T10), whose emitter is connected to the bases of the seventh and eighth transistors (T7, T8) and whose collector is connected to the reference-earth potential, by an eleventh transistor (T11), whose collector is connected to the supply potential (V), whose base is connected to the collector of the eighth transistor (T8) and whose emitter is connected to the base of the tenth transistor (T10), and by a current mirror (T12, T13, R9, R10), whose input path is coupled to the base of the ninth transistor (T9) and whose output path is coupled to the base of the tenth transistor (T10).</claim-text></claim>
<claim id="c-en-01-0008" num="0008">
<claim-text>Circuit arrangement according to one of Claims 3 to 7,<br/>
characterized in that an eleventh resistor (R11) is connected between the bases of the seventh and eighth transistors (T7, T8), on the one hand, and the supply potential (V), on the other hand.</claim-text></claim>
<claim id="c-en-01-0009" num="0009">
<claim-text>Circuit arrangement according to one of Claims 4 to 8,<br/>
characterized in that the switching signal (S) is fed to the bases of the fifth and ninth transistors (T5, T9), in each case with the interposition of a buffer stage (T14, R12; T15, R13).</claim-text></claim>
</claims><!-- EPO <DP n="14"> -->
<claims id="claims03" lang="fr">
<claim id="c-fr-01-0001" num="0001">
<claim-text>Circuit pour générer une tension de référence pouvant être validé ou inhibé, comprenant
<claim-text>un premier transistor (T1) dont l'émetteur est relié à un potentiel de référence (M) et dont la base et le collecteur sont connectés l'un à l'autre,</claim-text>
<claim-text>un deuxième transistor (T2) dont la base est reliée à la base du premier transistor (T1),</claim-text>
<claim-text>une première résistance (R1) qui est branchée entre le collecteur du premier transistor (T1) et une borne de sortie (U) pour le prélèvement de la tension de référence,</claim-text>
<claim-text>une deuxième résistance (R2) qui est branchée entre le collecteur du deuxième transistor (T2) et la borne de sortie (U),</claim-text>
<claim-text>une troisième résistance (R3) qui est branchée entre l'émetteur du deuxième transistor (T2) et le potentiel de référence (M),</claim-text>
<claim-text>un troisième transistor (T3) dont la base est reliée au collecteur du deuxième transistor (T2) et dont l'émetteur est relié au potentiel de référence (M), et</claim-text>
<claim-text>une source de courant commandée (T4) qui est branchée entre un potentiel d'alimentation (V) et la borne de sortie (U) et qui est couplée, sur le côté d'entrée, au collecteur du troisième transistor (T3),</claim-text> caractérisé en ce que le trajet collecteur-émetteur du troisième transistor (T3) est branché en parallèle avec le trajet collecteur-émetteur d'un cinquième transistor (T5) et en ce que la base du cinquième transistor (T5) est commandée par un signal de commutation (S).</claim-text></claim>
<claim id="c-fr-01-0002" num="0002">
<claim-text>Circuit selon la revendication 1, caractérisé en ce que la source de courant commandée (T4) comprend un quatrième transistor (T4) dont le collecteur est relié au potentiel d'alimentation (V), dont l'émetteur est<!-- EPO <DP n="15"> --> relié à la borne de sortie (U) et dont la base est reliée au collecteur du troisième transistor (T3), et en ce qu'une source de courant supplémentaire (T7, T8, R4, R5, R6) est branchée entre la base et le collecteur du quatrième transistor (T4).</claim-text></claim>
<claim id="c-fr-01-0003" num="0003">
<claim-text>Circuit selon la revendication 2, caractérisé en ce que la source de courant supplémentaire (T6, T7, T8, R4, R5, R6) comprend :
<claim-text>un sixième transistor (T6) dont la base est reliée à la borne de sortie (U) et dont l'émetteur est relié au potentiel de référence (M) avec une quatrième résistance intercalée entre les deux ;</claim-text>
<claim-text>un septième transistor (T7) dont l'émetteur est relié au potentiel d'alimentation (V) avec une cinquième résistance (R5) intercalée entre les deux, dont le collecteur est connecté à la base du cinquième transistor (T5) et dont la base est couplée au collecteur du sixième transistor (T6) ;</claim-text>
<claim-text>un huitième transistor (T8) dont la base et le collecteur sont couplés l'un à l'autre ainsi qu'au collecteur du sixième transistor (T6) et dont l'émetteur est relié au potentiel d'alimentation (V) avec une sixième résistance (R6) intercalée entre les deux.</claim-text></claim-text></claim>
<claim id="c-fr-01-0004" num="0004">
<claim-text>Circuit selon l'une des revendications 2 ou 3, caractérisé en ce que le trajet collecteur-émetteur du sixième transistor (T6) est branché en parallèle avec le trajet collecteur-émetteur d'un neuvième transistor (T9) et en ce que la base du neuvième transistor (T9) est commandée par le signal de commutation (S).</claim-text></claim>
<claim id="c-fr-01-0005" num="0005">
<claim-text>Circuit selon la revendication 4, caractérisé en ce qu'une septième résistance (R7) est branchée entre les bases des sixième et neuvième transistors (T6, T9).<!-- EPO <DP n="16"> --></claim-text></claim>
<claim id="c-fr-01-0006" num="0006">
<claim-text>Circuit selon l'une des revendications 4 ou 5, caractérisé en ce que le signal de commutation (S) est amené à la base du neuvième transistor (T9) par le biais d'une huitième résistance (R8).</claim-text></claim>
<claim id="c-fr-01-0007" num="0007">
<claim-text>Circuit selon l'une des revendications 4 à 6, caractérisé par un dixième transistor (T10) dont l'émetteur est relié aux bases des septième et huitième transistors (T7, T8) et dont le collecteur est relié au potentiel de référence, par un onzième transistor (T11) dont le collecteur est relié au potentiel d'alimentation (V), dont la base est reliée au collecteur du huitième transistor (T8) et dont l'émetteur est relié à la base du dixième transistor (T10), et par un miroir de courant (T12, T13, R9, R10) dont la branche d'entrée est couplée à la base du neuvième transistor (T9) et dont la branche de sortie est couplée à la base du dixième transistor (T10).</claim-text></claim>
<claim id="c-fr-01-0008" num="0008">
<claim-text>Circuit selon l'une des revendications 3 à 7, caractérisé en ce qu'une onzième résistance (R11) est branchée entre les bases des septième et huitième transistors (T7, T8) d'une part et le potentiel d'alimentation (V) d'autre part.</claim-text></claim>
<claim id="c-fr-01-0009" num="0009">
<claim-text>Circuit selon l'une des revendications 4 à 8, caractérisé en ce que le signal de commutation (S) est amené aux bases des cinquième et neuvième transistors (T5, T9) en intercalant à chaque fois un étage-tampon (T14, R12; T15, R13) entre les deux.</claim-text></claim>
</claims><!-- EPO <DP n="17"> -->
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